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소개
Riviera는 고성능의 ASIC이나 수백만
GATE의 FPGA를 검증 할 때 Powerful하게 사용 됩니다.
Riviera는 long time
simulation시에 안정적인 OS인Unix, Linux와 Windows NT 운영 체제에서 사용할
수 있도록 지원 하고 있습니다.
Riviera에는 다음과 같은 feature가 포함되어져 있습니다.
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VHDL & Verilog compilers
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Libraries and source files management system
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VHDL / Verilog simulation engine with command
interpreter
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HDL Editor
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Waveform Viewer
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Code
Coverage
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Advanced Debugging Tools
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Graphical User Interface (GUI)
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추가로 Riviera는
ASIC 이나 High Density FPGA 디자인을 검증 할 때 컴파일, 시뮬레이션, 라이브러리와
소스 파일 관리를 Batch mode와 GUI(Graphical User Interface) mode에서
실행 할 수 있습니다.
모든 Riviera
프로 그램은 Command Line에서 제어 할 수 있으므로, 여러분의 디자인을 Automatic
검증 시 유용 하게 사용 될 수 있습니다. 또한 Riviera는 Command Line에서 Interpreter
방식을 포함 하고 있어 Simulation 이나 Environment를 제어 할 수 있습니다.
Riviera Verification Environment으로는
Hardware Acceleration(HES)를 지원 하고 있으며,아래와 같은 표준 내용을 지원
하고 있습니다:
Licensing
Riviera는
platform에 관계없이 사용할 수 있습니다. 하나의 예로 아래 그림과 같이 한 Design
team 내에서 서로 다른 platform을 사용 하고 있는 경우 FlexLM license
manager를 어느 곳에 설치 하든 관계 없이 다양한 Version의 같은 Software를
사용 할 수 있게 지원 하고 있습니다.
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A
Powerful HDL Editor
이HDL
Editor의 특징은 Syntax Check, 예약어 Highlighting, Source를
Section별로 Grouping 할 수 있습니다. 또한 컴파일 에러시
사용자가 쉽게 디버깅 할 수 있도록 하기 위해 컴파일 에러가
난 부분을 찾아 가는 기능을 제공 하고 있습니다. 이 기능은
macro와 text file에도 사용 가능 합니다.
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Advanced
Debugging Tools
Riviera는
HDL/Verilog 소스를 디버깅 할 때 아래와 같은 진보된 Feature를
이용 하여 보다 쉽게 소스 코드를 수정 하거나 디자인을
디버깅 할 수 있습니다.
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Code
navigation and tracing
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Custom
breakpoints
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Advanced
behavioral code debugger
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Waveform
Viewer
이
Waveform Viewer는 여러분이 시뮬레이션 결과를 분석 하거나
볼 때 보다 쉽게 하기 위해서 아래와 같은 Feature를 제공
하고 있습니다.
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VCD
& Extended VCD Support
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Waveform
Comparison
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Stimulators
Management
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Code
Coverage
Riviera는
보다 향상된 기능의 Code Coverage기능을 제공 하고 있습니다.
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Coverage
per instance
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Coverage
per unit
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Standalone
coverage viewing
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Mixed
Language Simulation
Riviera는
다양한 소스형태의(VHDL, Verilog, C-Models and EDIF Netlists)
Simulation을 지원 하고 있습니다. Mixed simulation은
디자이너가 IP Core를 사용 하거나 HDL module을 다양한
소스로 디자인 할 경우 사용 됩니다.
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Flexible
Modes of Operation
Riviera는
다른 Simulation Tool과 달리 다른 방법으로 설계 단계를
진행 하여도 무관 합니다.
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Batch
Mode
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Command
Line Mode
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GUI
Mode
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IPT
Ready
Riviera는
Hardware Acceleration(HES)을 지원 하고 있어 Simulation
Speed를 10배~100배정도 더욱 빠르게 하고 있습니다. Riviera
IPT
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EDIF
Netlist Support
Riviera
EDIF (Electronic Design Interchange Format) version
2.0.0을 지원 함으로써 EDIF-based design을 Simulation
할 수 있습니다.
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Interface
Languages
Riviera는
여러 Interface Language를 지원 하고 있어, 3rd
party EDA software products과 쉽게 Interface해서 사용
할 수 있습니다.
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Tcl/Tk
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PERL
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Swift
Model
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PLI
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VHPI
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Design
Team Management
Riviera의
Library Manager는 Library를 Server에 공유하여 Team 단위로
Project를 수행할 수 있게끔 도와줍니다.
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Active-HDL
Compatible
Riviera는
Acitve-HDL에서 만든 Source file을 바로 사용 할 수 있습니다.
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Platform
Independence
Riviera
software licenses는 OS에 관계없이 사용이 가능 합니다.
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